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EPM5064JC  

FPGAs (Field Programmable Gate Array)
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CPLD MAX 5000 Family 64 Macro Cells 33.3MHz 0.8um Technology 5V 44-Pin PLCC
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Beschreibung Technische Daten Unterlagen Einkaufsführer

EPM5064JC Beschreibung

CPLD MAX 5000 Family 64 Macro Cells 33.3MHz 0.8um Technology 5V 44-Pin PLCC

Technische Daten

Maximum Latches
128
Macrocells
64
Pins
44
Maximum Flip-Flops
84

EPM5064JC Unterlagen

Laden Sie Datenblätter und Herstellerdokumentation herunter für EPM5064JC

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